Ingénieur d'état-major senior DFT

Contracter: Phoenix, Arizona, États-Unis

Salaire : 62.00 USD par heure

Code du travail: 348634

Date de fin: 2024-04-26

Statut d'emploi: Expiré

Cet emploi n'accepte plus de candidatures
  • A propos du rôle:
    Nous recherchons un centre d'opérations de sécurité
  • Ingénieur DFT pour rejoindre notre équipe à Phoenix. Le candidat idéal aura une expérience de travail à un niveau SOC complet, avec la capacité de distiller les exigences de divers blocs et puces, de rédiger des spécifications et du RTL pour l'encapsulation et la logique de contrôle nécessaires.
  • Responsabilités :
  • Documenter les spécifications DFT et définir les exigences avec les équipes Silicon
  • Développer et mettre en œuvre l’architecture et l’infrastructure DFT
  • Piloter l’exécution de méthodologies DFX améliorées
  • Vérifier les implémentations DFT avec l'équipe DV
  • Générez des vecteurs de test structurels et analysez la couverture/la durée du test/le coût du test
  • Collaborer avec les concepteurs sur les problèmes DFT STA, physiques, d'alimentation et logiques
  • Afficher des vecteurs de test sur silicium et dans l'environnement de laboratoire
  • Gérer les plannings et soutenir les efforts d'ingénierie interfonctionnels
  • Diplôme de l'enseignement:
    BS en informatique ou en génie électrique
  • Compétences requises:
  • 3 to 7 years of experience in semiconductor design and development
  • Formation en génie électrique
  • Expérience avec l'automatisation de la conception électronique (EDA)
  • Familiarité avec la conception et le développement de semi-conducteurs
  • Experience in Hardware Design For Test (DFT) engineering
  • Knowledge of uP or GPU or Video Processing
  • Maîtrise des langages de script tels que TCL/Perl/Python
  • Agréable d'avoir des compétences :
    Développement de spécifications DFT
    Outils de conception et DFT conformes aux normes de l'industrie
    Débogage des modèles ATPG/MBIST
    Contraintes STA et leur interaction avec DFT
  • Expérience en analyse des causes profondes
    IP Top Scan insertion (all EDA solutions)
  • IP Top Mbist insertion (all EDA solutions)
Exigence d'emploi
  • EDA
  • conception de semi-conducteurs
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  • Chikha Singh
  • shikha.psingh@collabera.com
  • 9739937245
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